data/full_repos/permissive/478063538/decoder_2_4.v
data/verilator_xmls/3abc7a69-adeb-4231-8dff-8b34d6408d11.xml
module decoder_2_4 (a1, a2, en, z0, z1, z2, z3);

	input a1, a2, en;
	output z0, z1, z2, z3;
	
	assign z0 = (~a1) & (~a2) & en;
	assign z1 = (~a1) & a2 & en;
	assign z2 = a1 & (~a2) & en;
	assign z3 = a1 & a2 & en;
	
endmodule
module decoder_2_4 (a1, a2, en, z0, z1, z2, z3);


	input a1, a2, en;
	output z0, z1, z2, z3;
	
	assign z0 = (~a1) & (~a2) & en;
	assign z1 = (~a1) & a2 & en;
	assign z2 = a1 & (~a2) & en;
	assign z3 = a1 & a2 & en;
	
endmodule