data/full_repos/permissive/100975158/ProcessadorQuartus/MemoriaDeDados.v
data/verilator_xmls/2df99854-64a3-4cfa-af63-0a5a10e47014.xml
module MemoriaDeDados (input clock, sinal_ler, sinal_escrever,
                       input wire [6:0] endereco,
					             input wire [31:0] dado_escrever,
                       output wire [31:0] dado_ler);

  reg [31:0] memoria [0:127];
  always @ (posedge clock) begin
    if (sinal_escrever)
      memoria[endereco] <= dado_escrever;
  end

  assign dado_ler = (sinal_ler) ? memoria[endereco][31:0] : dado_escrever;

endmodule
module MemoriaDeDados (input clock, sinal_ler, sinal_escrever,
                       input wire [6:0] endereco,
					             input wire [31:0] dado_escrever,
                       output wire [31:0] dado_ler);


  reg [31:0] memoria [0:127];
  always @ (posedge clock) begin
    if (sinal_escrever)
      memoria[endereco] <= dado_escrever;
  end

  assign dado_ler = (sinal_ler) ? memoria[endereco][31:0] : dado_escrever;

endmodule